CIU32M010、CIU32M030 系统及存储器架构

 CIU32M010、CIU32M030 器件是基于 ARM Cortex M0 处理器的 32 位通用微控制器存储器芯片。采用了哈佛结构，具有低中断延迟时间和低成本调试特性，而且高集成度和增强的特性使这颗处理器适合于那些需要高性能和低功耗微控制器的市场领域。预先定义的存储器映射和高达 4GB 的存储空间，充分保证了系统的灵活性和可扩展性。

系统架构 

CIU32M010、CIU32M030 器件采用 32 位多层总线结构，该结构可使系统中的多个主机和从机之间的并行通信成为可能。多层总线结构包括一个 AHB 互联矩阵、两个 AHB 总线和两个 APB 总线。AHB 互联矩阵的互联关系接下来将进行说明。

CIU32M010、CIU32M030 主系统由以下两部分构成：

• 2 个驱动单元

– CPU 内核系统总线(S-bus)

– DMA 总线

• 2 个存储单元

– 内部闪存存储器

– 内部 SRAM

系统总线

此总线连接 CPU 内核的系统总线(外设总线)到总线矩阵，总线矩阵协调着内核和各个高速部件间的访问。

总线矩阵(Bus Matrix)

• 总线矩阵管理着内核系统总线与各外设模块的访问仲裁，总线矩阵由主模块总线及从模块总线组成。

• AHB 外设通过总线矩阵与系统总线相连。

• AHB 到 APB 桥(AHB2APB bridges-APB)。

• AHB 到 APB 桥在 AHB 与 APB 总线间提供同步连接。

注：当对 APB 寄存器进行 8 位或者 16 位访问时，该访问会被自动转换成 32 位的访问；桥会自动将 16 位或者 8 位的数据 扩展以配合 32 位的宽度。

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